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VHDL中状态机中为什么不能有边沿检测语句

发布时间:2019-08-07 02:54 来源:未知 编辑:admin

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  展开全部状态机应当在clock的有效边沿触发下按照不同的条件进行状态转换,而不是在不同条件下让clock的边沿是否有效。

  end process;追问我的设计要求就是在状态s0下,若是出现clock跳变,进行状态转移,否则停留在S0,您说的我也明白,但是您说的肯定执行成了另外的情况追答你应当这样描述状态机:

  每当clock的有效边沿出现时,检测当前状态是否为s0,若是s0则发生状态转移,否则状态不变。

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